Trate semiconductor, placa y plano de medida como una sola decisión
Una selección defendible une datos del dispositivo, red de bias, adaptación y masa, montaje, ruta térmica, fixture y aceptación en planos identificados. Cambiar bias, impedancias, laminado, transición, bonds, masa, temperatura de encapsulado o corrección del fixture puede cambiar el resultado. Por eso la comparación empieza por condiciones y clase de evidencia, no por el valor típico más atractivo.
Fije función, condiciones y clase de evidencia antes de comparar
Defina primero el papel: bajo ruido, driver, potencia, conversión, conmutación, atenuación, fase, detección, síntesis, transceptor, protección o pasivo integrado. Marque interfaces RF, LO, IF, DC, control, reloj y térmicas, junto con banda, ancho, forma de onda, factor de cresta, ciclo, impedancias, transitorios, temperatura y desadaptaciones creíbles.
Separe mínimos/máximos garantizados de valores típicos, caracterizados, simulados y de circuitos de aplicación. Registre revisión, código de pedido, encapsulado, proceso, condición de ensayo y plano de cada cifra. No combine ganancia de un bias, ruido de otra placa y potencia de otra temperatura en un punto ficticio.
Controle validez de parámetros S, planos y estabilidad
Identifique el archivo S por dispositivo, revisión, rejilla de frecuencia, bias, temperatura, impedancia y plano de calibración, aclarando si incluye encapsulado, bond, launch o fixture. Parámetros de ruido, modelos no lineales, load-pull y térmicos responden preguntas distintas y tienen dominios propios; toda extrapolación queda como riesgo medible.
La estabilidad no es solo K a bias nominal. Analice reflexiones de fuente y carga previstas y plausibles, terminaciones fuera de banda, resonancias de bias, parásitos, temperatura, estados de ganancia y encendido/apagado. Use métricas y círculos apropiados, añada gran señal o dominio temporal cuando proceda y verifique con desadaptación y alimentación representativas.
Diseñe polarización, secuencia y protección según la física
Cada rail debe incluir nominal, tolerancia, IDQ, límite, rampa, retardo, asentamiento, estado de enable y orden de apagado. Los dispositivos de depleción pueden exigir gate negativo antes del drain; la dispersión de umbral hace inseguro usar gate fijo para obtener corriente repetible. Incluya energía almacenada, hot plug, brownout, sobreimpulso y RF durante transiciones.
Asigne sobretensión, sobrecorriente, inversión, sobreexcitación RF, carga abierta/cortocircuitada, ESD, temperatura y oscilación entre dispositivo y placa. Mida tensión y corriente en el plano del dispositivo con ancho de banda suficiente. Tras un fallo debe existir recuperación definida o bloqueo seguro, no solo supervivencia puntual.
Cierre encapsulado, PCB, masa RF y ruta térmica
Convierta el dibujo en footprint o die attach, launch RF, stack-up, línea controlada, campo de vías, exposed pad o brida, colocación y transición al chasis. Masa RF y calor suelen compartir pad, vías o carrier; voids, longitud de bond, inductancia y planitud pueden alterar a la vez estabilidad y temperatura.
Calcule disipación interna por estado y defina temperatura de encapsulado, pad, placa base, PCB o ambiente, resistencia/impedancia térmica, interfaz, aire, ciclo, calor vecino y límite de unión o canal. Verifique la frontera en el layout real. Un Rth bajo no compensa un attach, spreading o disipador sin controlar.
Lleve el plano calibrado al DUT y verifique estados productivos
Declare el plano de calibración de VNA, ruido, potencia, linealidad, ruido de fase o conmutación y todo lo que queda hasta el semiconductor. Caracterice mitades de fixture, launches, sondas, adaptadores, cables y bias. La calibración in-fixture o el de-embedding solo vale en el rango validado; conserve datos brutos, corregidos y chequeos residuales.
Cubra frecuencia, gain state, bias, temperatura, potencia, modulación, mismatch, tiempos de control y equilibrio térmico. Incluya piezas o lotes representativos si importa la dispersión y establezca guard bands con incertidumbre y proceso. La aceptación identifica artículo, lote, revisiones de placa/fixture, calibración, software, método, incertidumbre y criterio.
Gestione bare die, trazabilidad y cambios como interfaces
Para bare die defina programa ESD, almacenamiento sellado, entorno seco o inerte tras apertura cuando proceda, limpieza, zona de toma, orientación, reverso, material/espesor de attach, curado, hilo o ribbon, geometría de bonds y ensayos visuales, pull o shear. Las air bridges y superficies activas no son una tapa de encapsulado.
Controle código, proceso, revisión de package/die, lote, date code, condición de almacenamiento, PCN/PDN, alternativos y triggers de recualificación. Cualificación, screening, fiabilidad y ambiente requieren norma, nivel e informe del dispositivo y flujo exactos. Un sustituto pin-compatible exige revisar de nuevo RF, bias, estabilidad, térmica, montaje y medición.
| Límite de decisión | Evidencia a fijar | Rechazar cuando |
|---|---|---|
| Función y estados | Papel, bandas, señal, ciclo, puertos, impedancias, ganancia, temperatura y fallos | la familia sustituye las condiciones |
| Datos y modelos | Código, revisión, garantizado/típico, tipo de modelo, bias, temperatura y validez | se mezclan condiciones incompatibles |
| Estabilidad y carga | Fuente/carga, fuera de banda, red de bias, parásitos y mismatch | K nominal es la única prueba |
| Bias y protección | Rails, IDQ, secuencia, límites, defaults, transitorios, apagado y recuperación | basta una fuente de laboratorio sin definir |
| Package y PCB | Footprint/attach, stack-up, launch, masa, vías, bonds, montaje e inspección | se copia el eval-board sin revisar |
| Térmica | Disipación, temperatura de referencia, ruta, interfaz, aire, ciclo y límite de unión | se cita Rth sin temperatura de caja/placa |
| Plano de medida | Calibración, modelo de fixture, validez, bruto, residual e incertidumbre | la corrección oculta un fixture no validado |
| Identidad y ciclo de vida | Lote, fecha, revisión, PCN, cualificación, aceptación, alternativos y re-test | el proceso genérico reemplaza la evidencia exacta |
Ejemplo: el ruido de la hoja de un LNA no es el resultado del receptor
Un LNA ofrece un ruido típico atractivo con cierto bias y en el plano de su placa de evaluación. El receptor usa otro laminado, protección de entrada, un launch más largo, bias conmutado y un transmisor cercano. La comparación lleva candidatos a los mismos planos y condiciones, separa límites garantizados de curvas típicas, usa las revisiones S/ruido correctas, analiza estabilidad con protección y switch, define secuencia, calcula unión desde disipación y pad, y caracteriza el fixture. Se miden ganancia, ruido, return loss, compresión, recuperación de blocker, corriente y temperatura. Se elige la pieza que cierra el receptor con margen y trazabilidad, no la cifra típica más pequeña.
Construya el flujo de selección y verificación
- Aprobar función, puertos, bandas, señal, ciclo, impedancias, controles y ambiente.
- Crear matriz separando garantizado, típico, caracterizado, simulado y derivado.
- Fijar código, package/die, revisiones de hoja y modelos, bias, temperatura y planos.
- Analizar adaptación y estabilidad en estados creíbles de fuente, carga, fuera de banda y transición.
- Aprobar secuencia, método IDQ, desacoplo, transitorios, protección y apagado seguro.
- Liberar attach, stack-up, launch, masa, vías, bonds, montaje e inspección.
- Calcular disipación y temperatura de unión/canal con frontera y ciclo reales.
- Caracterizar fixture, validar corrección y archivar medidas brutas y corregidas.
- Verificar RF, DC, control, térmica, mismatch y transición en muestras representativas.
- Publicar identidad, índice de evidencia, límites productivos, PCN, alternativos y re-tests.
Fallos ocultos por un buen valor típico
- Comparar típicos con bias, temperaturas o planos diferentes
- Usar S-parámetros fuera de frecuencia, bias o potencia válidos
- Tratar K nominal como única prueba de estabilidad
- Aplicar drain antes del gate negativo requerido
- Medir la alimentación en la fuente y no en el dispositivo
- Copiar un eval-board a otro stack-up sin revisión EM/térmica
- Calcular temperatura desde salida RF y no disipación interna
- Informar fixture como prestación intrínseca
- Manipular bare die sin reglas de almacenamiento, toma, bonds e inspección
- Aprobar un sustituto pin-compatible sin revisar RF, bias, térmica y evidencia
Información necesaria para una RFQ de semiconductor RF
- Función y papel de cadena; tecnología solo si es técnicamente necesaria
- Rangos RF, LO e IF, ancho, impedancia y planos nombrados
- Señal, modulación, crest factor, ciclos pico/medio y simultaneidad
- Ganancia/pérdida, ruido, potencia, compresión, linealidad, eficiencia, aislamiento, fase, delay y switching
- Mismatch fuente/carga, terminaciones fuera de banda, blockers, overdrive y recuperación
- Rails, tolerancias, IDQ, secuencia, lógica, inrush, transitorios y protecciones
- Package o die, footprint/die map, sustrato, launch, masa, bonds y montaje
- Disipación, temperatura de caja/placa, ruta térmica, ciclo y margen de unión
- Modelos S, ruido, no lineales, load-pull o térmicos con revisión
- Plano de calibración, fixture, sonda, de-embedding, banda, incertidumbre y correlación
- Temperatura de operación/almacenamiento y requisitos de entorno/manipulación
- Muestras, lotes, caracterización, cualificación, screening y aceptación productiva
- Código, ciclo de vida, plazo, PCN/PDN y política de alternativos
- Hojas, modelos, planos, informes brutos, certificados, lote y date code
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